VGA视频接口及显示规范

VGA视频接口及显示规范 ⎆⎆᱊ᰒ⼎఼ VGA㾚乥᥹ষঞᰒ⼎㾘㣗 1ǃ 㣗ೈ ᴀ䚼ߚ㾘ᅮњ⎆᱊ᰒ⼎఼᥹ᬊ䆒໛Ё㾚乥VGAֵো໪ 䚼᥹ষѦ䖲ⱘ⬉⇨⡍ᗻᷛ⿄ؐ੠ᴎẄ䜡᥹㽕∖Ǆ ᴀ䚼ߚ䗖⫼Ѣ⎆᱊ᰒ⼎఼᥹ᬊ䆒໛䯈ᷛޚ᥹ষVGA῵ ᢳ㾚乥ֵোⱘ䖲᥹Ǆ 2: ᓩ⫼Ⳍ݇㾘㣗: ǉVideo Electronics Standards AssociationǊ 3.ᴃ䇁ঞᅮН R\G\B ϝ෎㡆㾚乥ֵো H- Sync 㸠ৠℹֵো V- Sync എৠℹ...

⎆⎆᱊ᰒ⼎఼ VGA㾚乥᥹ষঞᰒ⼎㾘㣗 1ǃ 㣗ೈ ᴀ䚼ߚ㾘ᅮњ⎆᱊ᰒ⼎఼᥹ᬊ䆒໛Ё㾚乥VGAֵো໪ 䚼᥹ষѦ䖲ⱘ⬉⇨⡍ᗻᷛ⿄ؐ੠ᴎẄ䜡᥹㽕∖Ǆ ᴀ䚼ߚ䗖⫼Ѣ⎆᱊ᰒ⼎఼᥹ᬊ䆒໛䯈ᷛޚ᥹ষVGA῵ ᢳ㾚乥ֵোⱘ䖲᥹Ǆ 2: ᓩ⫼Ⳍ݇㾘㣗: ǉVideo Electronics Standards AssociationǊ 3.ᴃ䇁ঞᅮН R\G\B ϝ෎㡆㾚乥ֵো H- Sync 㸠ৠℹֵো V- Sync എৠℹֵো DDC ᭄᥂ᰒ⼎䗮䘧 EDID ໪䚼ᰒ⼎䆒໛ᷛ䆚᭄᥂ 4:᥹ষ⬉⇨⡍ᗻᡔᴃ㽕∖ 4.1 ᥹ষᅮН ᥹⚍ 㓪ো ᥹⚍ⱘߚ䜡䜡᥹ؐ 1 Pin 1 R Red input 0 ~ 0.7Vpp Positive 2 Pin 2 G Green input 0 ~ 0.7Vpp Positive 3 Pin 3 B Blue input 0 ~ 0.7Vpp Positive 4 Pin 4 GND Ground 5 Pin 5 GND Ground 6 Pin 6 Red Ground Negative 7 Pin 7 Green Ground Negative 8 Pin 8 Blue Ground Negative 9 Pin9 +5VDC 10 Pin10 Detect Sync.GND 11 Pin11 GND Ground 12 Pin12 SDA DDC Serial Data TTL-Level 13 Pin13 H sync TTL-Level 14 Pin14 V sync TTL-Level 15 Pin15 SCL DDC Serial Clock TTL-Level 4.2 ⬉⬉⇨ᗻ㛑㽕∖ ⬉⇨খ᭄ ᗻ㛑㽕∖ RǃGǃB input Range 0.0 - 0.7 Vp-p +/-5% 䕧ܹ䰏ᡫऍ䜡 75 ohm +/-5% VGA Detect Lowd 0.7V VGA +5V 4.75Vd VGA_5Vd5.25V SCLǃSDA TTL⬉ᑇ Low d 0.8V 2.4d Highd 5V H syncǃV sync TTL⬉ᑇ Low d 0.8V 2.4d Highd 5V Horizontal ˖30 to 94 KHz +/- 1KH 㸠ǃഎ 乥⥛䫕ᅮ㣗ೈ Vertical ˖ 56 to 75 Hz +/-0.5Hz ᳔໻ڣ㋴ clock 202MHz ᴀ㣗ೈᗻ㛑ᷛޚഛヺড় VESA ᷛޚঞ๲ᔎൟ᭄᥂ᰒ⼎䗮䘧ᷛޚ 5: TTL Input(SYNC-SIGNALS) TTL ⬉⇨⡍ᗻ㽕∖བϟ೒᠔⼎˖ 6: ⠽⠽⧚㒧ᵘሎᇌ೒ ᔧ݁㾦㶎ϱृড়ᢻϟᯊˈ⇻࣪ⲪϢᑻᄤ䖲Ўϔԧ 7: DDCঞ EDID 6.1ˊDDC: Display Data Channel (᭄᥂ᰒ⼎䗮䘧)----ᣛЏᴎ Ϣᰒ⼎䆒໛ⱘ䗮䆃ᮍᓣǄ ෎ѢEnd-user ⱘेᦦे⫼ࡳ㛑ⱘ䳔∖ˈVESA ᅮНњ DDC ᷛޚǄࣙ৿DDC1/DDC2B ㄝᮍᓣ � Ɣ''&�ᰃЏᴎϢᰒ⼎䆒໛ऩ৥䗮䆃 ҹˈV-SyncЎClockǄᰒ⼎఼ ϡذⱘ৥Џᴎথ䗕EDID䌘᭭Ǆ � Ɣ''&�%ᰃЏᴎϢᰒ⼎䆒໛ޚঠ৥䗮䆃ˈ෎ѢI2C 䗮䆃ण䆂Ǆ া᳝Џᴎ৥ᰒ⼎఼থߎ䳔∖ֵোˈᑊᕫࠄᰒ⼎఼ⱘડᑨৢˈ ᰒ ⼎఼ᠡ䗕ߎEDID 䌘᭭Ǆ ⳂࠡDDC1 ෎ᴀϞᏆ㒣ϡݡՓ⫼ˈЏ㽕ᰃ䞛⫼DDC2B ᮍᓣǄ PC2001 㾘ᅮϡ㛑ݡՓ⫼DDC1 6.2ˊ EDID: Extended Display Identification Data (໪䚼ᰒ⼎䆒 ໛ᷛ䆚᭄᥂)----ᣛ DDC 䗮䆃ЁӴ䕧ⱘᰒ⼎䆒໛᭄᥂Ǆ EDID ࣙ৿ᰒ⼎䆒໛ⱘ෎ᴀখ᭄ˈབࠊ䗴ॖଚǃ⫳ѻ਼ᳳǃѻ કৡ⿄ǃ᳔໻㸠എ乥ǃৃᬃᣕⱘߚ䕼⥛ㄝǄEDID䗮䖛DDC ⚻ᔩ⿟ᑣ ᇚEDIDݭܹEEPROM ៪CPU RAM 䞠. DDC 䗮䆃ᮍᓣབϟ೒᠔⼎˖ IIC䗮䆃level 8:ⳌⳌ݇ᡔᴃ⌟䆩ᣛᷛ ᣛᷛৡ⿄˖VGA೒ڣ䋼䞣 ⌟䆩ᮍ⊩ঞᣛᷛབϟ೒᠔⼎˖

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