eda实验数字计时器设计

eda实验数字计时器设计 数字计时器设计 一、实验目的 1、掌握常见集成电路的工作原理和使用方法。 2、学会单元电路的设计调试方法。 3、掌握QuartusII软件的基本使用方法及会用其设计调试数字计时器。 二、实验设计要求 1、能进行正常的时、分、秒计时功能; 2、分别由六个数码管显示时分秒的计时; 3、系统有保持、清零、校时、校分功能; 59'53"4、使时钟具有整点报时功能(当时钟计到时开始计时，分别在 59'59"报时频率500Hz，在报时频率1000Hz); 59'53",59'55",59'57" 5、闹表设定功能。 三、整体电路的工作原理 原理框图: 译码显示电路 选择译码电路 界面显示切换开关 计时器电路 整点报时电路 脉冲产生电 路 校时校分 保持 清零 闹钟定时电路 比较电路 闹 铃 定时 定分 闹铃电路 开 关 脉冲产生电路将硬件上的48MHz脉冲依次分频使其产生1Hz脉冲，输入计时器电路， 00:00:00~计时器电路时分秒对应的模24、模60、模60计数器采用同步触发方式实现 23:59:59计时。 1 校时校分电路通过校时、校分开关的切换来改变计时器电路时分秒对应的模24、模60、模60计数器CLK端输入脉冲及使能端的设置实现。 保持电路通过使计时器三个计数器使能端置0的方法来实现。 清零电路通过使计时器三个计数器清零端置0的方法来实现。 整点报时电路通过脉冲产生电路的分频及若干门电路组合实现。 闹表: 先设计一48选24的译码选择电路对计时器电路与闹钟定时电路的输出进行选择，界面显示切换通过设置一开关对译码选择电路的控制实现。 定时定分电路设计原理与上校时校分电路一致。 闹铃的设置是先通过一比较电路判断此时计时器电路的时分与闹钟定时电路是否一致来判断是否响铃，铃声是通过数据选择器及若干门电路来对响铃频率的设定。 最后设置一闹铃开关来实现闹表的开关。 四、各子模块设计原理及仿真波形 1、脉冲发生电路(分频电路) 原理图见附表1 用到了四分频、六分频、八分频和一千分频电路，下面以六分频和一千分频为列 说明 关于失联党员情况说明岗位说明总经理岗位说明书会计岗位说明书行政主管岗位说明书 : A、六分频电路: clk JKFFJKFFJKFFVCCq[0]q[1]q[2]PRNPRNPRNJQJQJQt[1]t[2] KKKCLRNCLRNCLRNinstinst1inst2 AND2AND2q[1]q[0]m[0]m[1]NOTq[2]q[1] inst3inst9inst7 OR2OR2m[0]m[1]t[1]t[2]q[0]m[0] inst8inst5 INPUTOUTPUTclkq[2]VCC OUTPUTq[1] OUTPUTq[0] 它是应用了三个JK触发器构成的T触发器， tqqq[1][2][1][0],， tqqqq[2][2][1][0][1],， qqq[2][1][0]依次循环输出:000 001 010 101 110 111;从而输出q[2]就是将clk六分频，且脉宽仍为50% 仿真波形: 2 B、一千分频电路 count10count10count10clkqclkq[2]clkq[2]clkq[2] inst1instinst2 INPUTclkVCC OUTPUTq 是由三个十分频电路组合而成，十分频电路: clk JKFFJKFFJKFFJKFFVCCq[0]q[1]q[2]q[3]PRNPRNPRNPRNJQJQJQJQt[1]t[2]t[3] KKKKCLRNCLRNCLRNCLRNinstinst1inst2inst5 NOTAND2AND2q[3]q[0]t[1]t[2]q[0]q[1]inst6AND2q[0]inst7inst3q[3] OR2inst10t[3]INPUTclkVCC inst9AND3q[0]q[1]q[2]OUTPUTq[2]inst8 其是在十六分频器基础上更改而成:，， tqq[2][1][0],tqq[1][3][0], tqqqqq[3][2][1][0][3][0],， 依次循环输出0000 0001 0010 0011 0100 0101 0110 0111 1000 1001;从而输qqqq[3][2][1][0] 出q[2]就是将clk十分频，且脉宽为40% 2、计时器电路(原理图见附表一) A、模60计数器 3 q[0] q[0] 7416074160t[0]LDNLDN AAq[1]h[1]BQABQAq[2]h[2]CQBCQBq[3]h[3]DQCDQCq[4]h[4]ENTQDENTQDen[1]ENPRCOENPRCO CLRNCLRN CLKCLKGNDCOUNTERCOUNTERinst1instclk INPUTclkNAND5VCCq[1]IN1OUTPUTq[1]q[4]IN2h[1]t0OUTPUTq[2]IN3OUTh[3]IN4OUTPUTq[3]key7IN5OUTPUTq[4]inst2 INPUTkey7VCCOUTPUTh[1] OUTPUTh[2]INPUTq[0]VCCOUTPUTh[3]INPUTen[1]VCC OUTPUTh[4] 利用两块74160BCD码计数器，左边显示秒(分)个位，右边显示秒(分)十位，右边芯片通过同步送数端 (此时校时校分作用端始终为高电平)， key7tqqhh0[1][4][3][1], 实现0 1 2 3 4 5输出的模6计数器。 仿真波形: B、模24计数器 4 q[0] 7416074160t[1]t[1]LDNLDNt[2]AAq[1]h[1]BQABQAt[2]q[2]h[2]CQBCQBq[3]h[3]DQCDQCq[4]h[4]ENTQDENTQDen[0]ENPRCOENPRCO CLRNCLRN CLKCLK COUNTERCOUNTERinst1instclk INPUTNAND4h[2]clkVCCq[1]t[2]t[1]OUTPUTq[2]q[1] key8OUTPUTGNDq[2]inst3OUTPUTq[3]INPUTkey8VCCOUTPUTq[4] OUTPUTh[1]INPUTen[0]VCCOUTPUTh[2] INPUTq[0]VCCOUTPUTh[3] OUTPUTh[4] 利用两块74160BCD码计数器，左边显示时个位，右边显示时十位，利用同步送数端 (此时校时校分作用端始终为高电平)实现计数到23时全部同key8tqqh[1][1][2][2], 步送0 仿真波形: 00:00:0023:59:59C、~计时器两模60，一模24计数器衔接电路: 59''en[1]en[2]作用于分计数器使能端以实现分钟进一位，作用于时计数器使能端以实现 5 59'59''时钟进一位。 计时器仿真输出波形: 3、译码显示电路(原理图见附表1) VCC 计数器为0 1 2 3 4 5 计数的模6计数器(设计思路与模60计数器的十位一致): LDN Aq[0]74160BQAt[0] CQB DQCq[1] ENTQDq[2] ENPRCOq[3]NAND2 CLRNq[4]GND q[1]inst3CLKt[0]q[0]q[3]COUNTERinst clk3 INPUTclk3VCC OUTPUTq[1] OUTPUTq[2] OUTPUTq[3] OUTPUTq[4] 6 24选4MUX采用4个8选1的74151数据选择器实现，CLK2选用1000Hz脉冲，在每一极短时刻(1/1000秒)依据计数器同时选定要编译的4位码及相应的数码管，让其中一个数码管显示，由于1/1000秒以超出人眼辨别范围，故某一时刻感觉相应的六个数码管均亮。 4、清零、保持、校时校分电路(原理图见附表1) A、清零电路只须将计时器各清零端解入一开关信号qing(低电平有效) B、保持电路只须将计时器各使能端接入一保持信号keep，电路 NOTkeep0keep inst43 keep0为开关输入信号(高电平有效)。 ,、校时校分电路: NAND21hz NAND2OR2DFFjiaoclk1inst18NOTPRNjiao1DQ1hzinst19inst21inst30NAND2 2hzCLRNinst29inst20 jiao为校分开关信号，jiao1为校时开关信号，D触发器是防止开关造成的颤动，比如jiao信号为1电平时，计时器时分秒时钟脉冲输入端均为2Hz，同时使秒钟使能端输入为0(即秒输出不变)，分钟使能输入端为1(即分钟开始快速校分)，可参考附表1计时器电路模块及衔接电路模块。 5、报时电路(原理图见附表1) AND8NOTmh[3]key6 mh[1]inst88ml[4] ml[1]AND2NAND2sl[2]sh[3] sh[1]inst87sl[1]inst3500hz inst44NAND2NAND3OR2baoshisl[3]laozhong inst7inst27inst81 NAND2sl[4] clk2 inst26 设秒个位所对应的计数器的输出:slslslsl[4][3][2][1];秒十位所对应的计数器的输出:shshshsh[4][3][2][1];分个位所对应的计数器的输出:mlmmlml[4][3][2][1];分十位所对 mhmhmhmh[4][3][2][1]应的计数器的输出:;其中4为高位，1为低位。 7 在时计数器秒十位，分个位，分十位输出相同，为: 59'53",59'55",59'57",59'59" ，，shshshsh[4][3][2][1]0101,mlmmlml[4][3][2][1]1001, 。 mhmhmhmh[4][3][2][1]0101, 秒个位输出: 59'53" :=0011 slslslsl[4][3][2][1] 59'55" :=0101 slslslsl[4][3][2][1] 59'57" :=0111 slslslsl[4][3][2][1] 59'59" :=1001 slslslsl[4][3][2][1] 则此时的触发信号 baoshiffff,，，，59'53"59'55"59'57"59'59"1112 ,，，，59'51"(2"4"6"8")ffff1112 其中， fHz,500fHz,100012 原理图中为闹铃开关，是为了在闹铃想时屏蔽整点报时。 key6 6、补充功能:闹表(原理图见附表2) A、闹表定时电路(见附表2相应模块) 由一个模六十计数器(定分)及一个模24计数器(定时)构成。 B、选择译码电路(见附表2相应模块) 由3个16选8自定义数据选择器实现，依次选择时分秒的显示译码(其中当界面切换到定时界面时，秒钟输出均为1电平，从而对于共阳极的数码管秒钟不亮)，每一个16选8自定义数据选择器原理图: 8 NOTAND2key5NOTAND2inst3akey5OR2instinst10o1eOR2inst16o5AND2inst1AND2inst8a1inst2e1inst9 NOTAND2key5binst7OR2NOTAND2key5INPUTkey5o2inst4VCCfinst15OR2AND2o6inst5inst12INPUTab1VCCAND2OUTPUTo1inst13inst6f1INPUTa1VCCinst14OUTPUTo2INPUTbVCCOUTPUTo3INPUTb1VCCNOTAND2key5NOTAND2OUTPUTo4key5INPUTccinst23VCCOR2ginst19OR2o3inst20OUTPUTo5o7inst17INPUTc1VCCAND2inst21AND2inst11c1INPUTOUTPUTdo6g1VCCinst22inst18INPUTOUTPUTd1o7VCCNOTAND2key5INPUTeVCCNOTAND2OUTPUTo8dkey5inst27OR2o4hinst24inst31OR2INPUTe1VCCo8inst28AND2inst25AND2INPUTd1finst29VCCh1inst26INPUTf1inst30VCCINPUTgVCC INPUTg1VCC INPUThVCC INPUTh1VCC 界面切换开关来实现输出的译码显示。 key5 C、定分、定时电路 AND2AND2key5key5v0v1key7key8 inst53inst54 v0、v1依次接分钟和时钟的使能端，用来进行定分和定时，即定分开关、定key7key8时开关、此处是为了当界面切换到实际计时界面时，将闹钟定的时间保持住，同时使 key5 、无效。 key7key8 D、比较电路(原理图见附表2相应模块) 是采用16个异或门来判别实际时分是否与闹钟时分一致，若一致则f17输出为1。 E、闹铃电路(原理图见附表2相应模块) 通过改变输入蜂鸣器的脉冲频率使其发出不同声音，组合到一起形成闹铃，主要是: 让其响铃1分钟; 秒个位为1时输出250hz; 秒个位为3、4、5时输出为250hz、500hz、1000hz; 秒个位为7、8、9时输出为500hz、1000hz、2000hz; 秒个位为0、2、6时输出为0。(即输出声音逐渐变高) 250hz、2000hz脉冲产生补充分频电路: 9 count6count4 48000hz2000hzclkq[2]clkq[1] q[1]q[0] q[0]inst37inst38 JKFFt[5]PRNJQ500hz 250hz Kinst73CLRN 采用2个74151实现16选用1数据选择器来选择频率信号: 输入秒个位来决定此时的铃声输入脉冲。 slslslsl[4][3][2][1] 最终蜂鸣器输入: 当f17为1,且闹铃开关key6有效时，才响铃。 10 五、实验过程中遇到的问 题 快递公司问题件快递公司问题件货款处理关于圆的周长面积重点题型关于解方程组的题及答案关于南海问题 及解决问题的方法 58'59''59'00''1、在计时器模块设计中,将秒钟和分钟组合时仿真发现输出依次为、、 09'01''09'02''、……，下面 分析 定性数据统计分析pdf销售业绩分析模板建筑结构震害分析销售进度分析表京东商城竞争战略分析 : 我设计的模60计数器: q[0] q[0] 7416074160t[0]LDNLDN AAq[1]h[1]BQABQAq[2]h[2]CQBCQBq[3]h[3]DQCDQCq[4]h[4]ENTQDENTQDen[1]ENPRCOENPRCO CLRNCLRN CLKCLKGNDCOUNTERCOUNTERinst1instclk INPUTclkNAND5VCCq[1]IN1OUTPUTq[1]q[4]IN2h[1]t0OUTPUTq[2]IN3OUTh[3]IN4OUTPUTq[3]key7IN5OUTPUTq[4]inst2 INPUTkey7VCCOUTPUTh[1] OUTPUTh[2]INPUTq[0]VCCOUTPUTh[3]INPUTen[1]VCC OUTPUTh[4] 59'00''由于十位的使能端是由个位进位端作用的，在时分个位进位输出为1，故当下 09'01''一个时钟脉冲到来时，分的十位仍会计数，从而下一秒输出为，其中一种解决方法 x9'59''是将分十位使能端由分个位进位端及秒进位信号共同作用，使必须在时分十位才进位。 00:59:002、在计时器模块设计中,将秒钟、分钟及时钟组合时仿真发现输出依次为、01:59:0102:59:02、……显然在59分时，时钟使能端始终为1，故应当再增加秒进位信号对时钟式能端影响。 3、校时校分结束时拨动开关由于振动的影响而使计时输出变化较大，可通过在开关信号后接一D触发器来消除颤动。 4、校时校分及闹钟定时定分时23时无法保持住、59分无法保持住(即若校到23时会自动变为03时，若校到59分时则自动变为09分) 以上述的模六十计数器为例: 当定分到59分时，由于，会使分十位计数器的同步送数端有效，从而tqqhh0[1][4][3][1], 11 无法定时保持在59分，可通过让定分开关也作用同步送数key7tqqhhkey0[1][4][3][1]7, 端实现。 5、响铃与整点报时在闹钟设为59分时会冲突，故可通过: 实现冲突时对整点报时电路的屏蔽。 六、实验感想 我完全通过硬件的搭载来实现电路的功能，通过实验我首先对QuartusII软件的使用有一个基本的了解，在各个模块的设计、仿真、调试、分析中，让我对数字电路相关的理论知识有一个更形象深入的掌握。 希望以后在类似的实验课程中能够更加主动地思考，积极提问，深入探究，提高自己的研究能力。 12