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计算机组织与原理A卷一、选择题(每空2分,共30分)1程序计数器PC用来存放指令地址,每当执行完一条指令后,通常由程序计数器提供后继指令地址,其位数和()位数相同。A、指令寄存器IR?B、指令译码器IDC、程序状态寄存器PSD、主存地址寄存器MAR2、下列数中最大的数为()。A、(11000)BCD24B、(23)10C、(...

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A卷一、选择 快递公司问题件快递公司问题件货款处理关于圆的周长面积重点题型关于解方程组的题及答案关于南海问题 (每空2分,共30分)1程序计数器PC用来存放指令地址,每当执行完一条指令后,通常由程序计数器提供后继指令地址,其位数和()位数相同。A、指令寄存器IR?B、指令译码器IDC、程序状态寄存器PSD、主存地址寄存器MAR2、下列数中最大的数为()。A、(11000)BCD24B、(23)10C、(25)821D、(19)1625中,零的表示形式是唯一3、在机器数(的。A原码B补码C移码D反码4、IEEE754标准 规定 关于下班后关闭电源的规定党章中关于入党时间的规定公务员考核规定下载规定办法文件下载宁波关于闷顶的规定 的32位浮点数格式中、符号位为1位,阶码为8位,尾数为23位。则它所能表示的最大规格化正数为()。A+(2-223)X2+127B、+(1-2-23)X2+127C+(2-223)X2+255D、2+127—22301,则()5、若采用双符号位补码运算,运算结果的符号位为、产生了正溢出(上A、产生了负溢出(下溢)B溢)C、结果正确,为正数D6、向右规格化的规则为:尾数(),阶码(A.右移1位,加1)B.左移1位,力口1。C.右移1位,减1D.左移1位,减17、某DRAI芯片,其存储容量512KX8位,该芯片的地址线和数据线数数目为)为(。A8,512B、512,8C、18,19,88D8、外存储器与内存储器相比,外存储器()。A、速度快,容量大,成本高B、速度慢,容量大,成本低C、速度快,容量小,成本高D、速度慢,容量大,成本高9、堆栈寻址方式中,设A为累加器,MS为SF指示的栈顶单元。如果进操作的动作顺序是(A)TMSP(SP)-1栈________________TSP。那么出栈操作的动作顺序应为A、(MSP尸A,(SP)+1TSPB、(SP)+1TSP,(MSP)TAC(SP-1)TSP,(MSP)TAD、MSPTA,(SP)-1TSP10、就取得操作数的速度而言,速度最慢的是(C),速度最慢的是(A),不需要访存的寻址方式是(B、D)A、直接寻址B、寄存器寻址C、间接寻址D、隐含寻址11、程序计数器属于()。A、控制器B、运算器C、存储器D、输入输出接口12、某型计算机系统的微处理器的主频为100MHZ四个时钟周期组成一个机器周期,平均三个机器周期完成一条指令,则它的机器周期为()nsA、40B、50C、80D、10013、CRT的分辨率为1024x1024像素,像素颜色数为512,则刷新存储器容量是()。A、256KBB、512KBC、2MBD、1MB二、填空题:(每空1分,共10分)1、中央处理器由—运算器—和控制器两部分组成。2、是指存储在能永久保存信息的器件中的程序,是具有软件功能的硬件。执行程序时,必须将指令存放在Cache3、辅存、主存和高速缓冲存储器(Cache)构成了系统的三级存储系统。在CPU执行程序时,必须将指令存放在Cache4、用一个字节存放一个ASCII码时,字节的最左边一位可作为校验码,用来检查错误。5、某指令的操作码字段有6位,则其能表示的操作有_64__________种。6、存储器的最小单位为字节,1KB容量的存储器能够存储1024个这样的基本单位。7、微程序入口地址是根据机器指令的产生的。三、名词解释(9分)1、动态流水线:2、中断源:3、总线:四、简答题(每小题9分,共36分)1、已知X=+10001111,Y=—1011,用原码不恢复余数除法计算X/Y=?,要求写出计算过程。2、何谓中断隐指令?中断隐指令有哪些功能?CPU响应中断后,经过某些操作,转去执行中断服务程序。这些操作是由硬件直接实现的,我们把它称为中断隐指令。主要操作:保存断点、关中断、取得中断服务程序的入口地址3、简单叙述组合逻辑控制器和微程序控制器的异同点。4、CPU执行一段程序时,cache完成存取的次数为1900次,主存完成存取的次数为100次,已知cache存取周期为50ns,主存存取周期为250ns,求cache/主存系统的效率和平均访问时间。五、应用题(共15分)某模型机主要部件框图如下图所示,其中R0R1为通用寄存器,AB为暂存器、其名称已标于图上。(1)画出数据通路,并标明数据流方向。(6分)(2)给出以下指令的操作 流程 快递问题件怎么处理流程河南自建厂房流程下载关于规范招聘需求审批流程制作流程表下载邮件下载流程设计 图:(9分)①MOVR0,R1;(R0)TR1②MOV(R0),R1;((R0))TR1③MOVR0,(R1);)((R0TR1)移位器R0R1ALUR2R3一、选择题(每小题2分,共30分)1、在机器数()中,零的表示形式是唯一的。A原码B补码C移码D反码2、主存储器和CPU之间增加cache的目的是()。A解决CPI和主存之间的速度匹配问题B扩大主存储器容量C扩大CPI中通用寄存器的数量D既扩大主存储器容量,又扩大CPI中通用寄存器的数量3、下列数中最大的数为()。A(101001)2B、(52)8C、(101001)BCDID、(233)104、针对8位二进制数,下列说法中正确的是()。A、一127的补码为10000000B、一127的反码等于0的移码C+1的移码等于一127的反码D、0的补码等于一1的反码5、IEEE754标准规定的32位浮点数格式中、符号位为1位,阶码为8位,尾数为23位。则它所能表示的最大规格化正数为()。A+(2-223)X2+127B、+(1-2-23)X2+12723、^+255+127^23C+(2-2)X2D、2—26、运算器由许多部件组成,但核心部件应该是()。A、数据总线B、数据选择器C算术逻辑运算单元D、累加寄存器。7、某DRA芯片,其存储容量为512KX8位,该芯片的地址线和数据线数数目为()。A8,512B、512,8C、18,8D、19,88、就取得操作数的速度而言,下列寻址方式中速度最快的是(B),速度最慢的是(C),不需要访存的寻址方式是(B)A、直接寻址B、立即数寻址C、间接寻址9、指令周期是指(C)。ACPI从主存取出一条指令的时间B、CPU执行一条指令的时间CCPI从主存取出一条指令加上执行这条指令的时间时钟周期时间10、微程序控制器中,机器指令与微指令的关系是(B)。A、每一条机器指令由一条微指令来执行;每一条机器指令由一段用微指令编成的微程序来解释执行;一段机器指令组成的程序可由一条微指令来执行D—条微指令由若干条机器指令组成11、计算机操作的最小时间单位是()。A、时钟周期B、指令周期C、CPU周期D、微指令周期12、数据总线的宽度由总线的(A)定A、物理特性B、功能持性义。、电气特性D、时间特性C13、计算机系统的输入输出接口是()之间的交接界面。A、CPU与存储器B、主机与外围设备C、存储器与外围设备D、CPU与系统总线二、判断题。(每空1分,共10分)1、阶码部分在乘除运算时只进行加、减操作。2、随机半导体存储器(RAM)中的任何一个单元都可以随时访问;()3、只读存储器(ROM中的任何一个单元不能随机访问;4、定点补码运算时,其符号位不参加运算。()5、一般情况下,ROM和RAM在存储体中是统一编址的;6、由于半导体存储器加电后才能存储数据,断电后数据就丢失了,因此,用EPROM做成的存储器,加电后必须重写原来的内容。()7、与各中断源的中断级别相比较,CPU(或主程序)的级别最高。)&浮点数的正负由阶码的正负符号来决定。()9、因为动态存储器是破坏性读出,必须不断地刷新;10、中断级别最高的是不可屏蔽中断。三、名词解释(9分)1、标量处理机:2、吞吐率:3、汉字机内码:四、简答题(每小题9分,共36分)1、假定计算机的主存储器按64块组织,块大小为8个字,高速缓存有8个块。试表示出下述(1)—(3)中从主存储器编号的块到高速缓存中块的映像关系,尽可能清楚地画出所有的映像线。1)表示出直接相联映像以及指定标记字段、块号和字号的地址位。2)表示出全相联映像以及指定标记字段和字号的地址位。3)表示出2路组相联映像以及指定标记字段、组号和字号的地址位。2、已知x=0.10111,y=0.11011,要求用变形补码计算x+y的补码。同时指出运算结果是否溢出。假设机器字长为8位。3、一台模型机共有7条指令,各指令的使用频率分别为35%25%20%10%,5%3%和2%有8个通用数据寄存器,2个变址寄存器。(1)要求操作码的平均长度最短,请 设计 领导形象设计圆作业设计ao工艺污水处理厂设计附属工程施工组织设计清扫机器人结构设计 操作码的编码,并计算所设计操作码的平均长(2)设计8字长的寄存器-寄存器型指令3条,16位字长的寄存器-存储器型变址寻址方度。式指令4条,变址范围不小于土127。请设计指令格式,并给出各字段的长度和操作码的编码。4、设将指令划分为三个时间段t取t译t执来完成。分别采用顺序执行,有两条指令重叠,有三条指令重叠。都执行K条指令,分别写出三种执行方式所需时间表达式;若K=300,即有300条件指令,t取=4At,t译=5At,t执=6At,分别计算三种执行方式所需时间五、设中断级屏蔽位“1”对应于开放,“0”对应于屏蔽,各级中断处理程序的中断级屏蔽位设置如下表:中断处理程级屏蔽位序级别1234-一-0000-二二1011-三1000四1010问:1)当中断响应先后次序为1—2—3—4,其中断处理次序是什么?(5分)2)如果所有的中断处理都各需要3个单位时间,当正在运行主程序时,同时发生2、3过两个单位时间又同时有1、4级中断请求,试画出中断响应处理时空图(10分)级中断请求,
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上传时间:2021-09-24
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