54161/74161
4 位二进制同步计数器(异步清除)
简要说明:
161 为可预置的 4 位二进制同步计数器,共有 54/74161 和 54/74LS161 两种线路结
构型式,其主要电特性的典型值如下:
型号 FMAX PD
CT54161/CT74161 32MHz 305mW
CT54LS161/CT74LS161 32MHz 93mW
161 的清除端是异步的。当清除端 CLEAR 为低电平时,不管时钟
端 CLOCK 状态如何,即可完成清除功能。
161 的预置是同步的。当置入控制器 LOAD 为低电平时,在 CLOCK
上升沿作用下,输出端 QA-QD 与数据输入端 A-D 相一致。对于
54/74161,当 CLOCK 由低至高跳变或跳变前,如果计数控制端 ENP、
ENT 为高电平,则 LOAD 应避免由低至高电平的跳变,而 54/74LS161
无此种限制。
161的计数是同步的,靠CLOCK同时加在四个触发器上而实现的。
当 ENP、ENT 均为高电平时,在 CLOCK 上升沿作用下 QA-QD 同时变
化,从而消除了异步计数器中出现的计数尖峰。对于 54/74161,只
有当 CLOCk 为高电平时,ENP、ENT 才允许由高至低电平的跳变,而
54/74LS161 的 ENP、ENT 跳变与 CLOCK 无关。
161 有超前进位功能。当计数溢出时,进位输出端(RCO)输出
一个高电平脉冲,其宽度为 QA 的高电平部分。
在不外加门电路的情况下,可级联成 N 位同步计数器。
对于 54/74LS161,在 CLOCk 出现前,即使 ENP、ENT、CLEAR 发
生变化,电路的功能也不受影响。
管脚图:
引出端符号:
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PCO 进位输出端
CLOCK 时钟输入端(上升沿有效)
CLEAR 异步清除输入端(低电平有效)
ENP 计数控制端
ENT 计数控制端
ABCD 并行数据输入端
LOAD 同步并行置入控制端(低电平有效)
QA-QD 输出端
功能
表
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:
说明:H-高电平
L-低电平
X-任意
↑-低到高电平跳变
极限值
电源电压------------------------------------------------7V
输入电压
54/74161-----------------------------------------5.5V
54/74LS161---------------------------------------7V
ENP 与 ENT 间电压
54/74161-----------------------------------------5.5V
工作环境温度
54×××------------------------------ -55~125℃
74×××------------------------------------0~70℃
贮存温度-------------------------------------- -65~150℃
推荐工作条件:
CT54161/CT74161 CT54LS161/CT74LS161
最小 额定 最大 最小 额定 最大
单位
54 4.5 5 5.5 5.5
电源电压 Vcc
74 4.75 5 5.25 4.75 5 5.25
V
输入高电平电压VIH 2 2 V
54 0.8 0.7
输入低电平电压VIL
74 0.8 0.8
V
输出高电平电流IOH -800 -400 μA
电子
工程
路基工程安全技术交底工程项目施工成本控制工程量增项单年度零星工程技术标正投影法基本原理
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采购
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54 16 4
输出低电平电流IOL
74 16 8
mA
时钟频率fCP 0 25 0 25 MHz
CLOCK 25 25
脉冲宽度 tW
CLEAR 20 20
ns
A-D、ENP 20 20
建立时间tset
LOAD 25 20
ns
保持时间tH 0 0 ns
时序图:
逻辑图
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静态特性(TA为工作环境温度范围)
`161 `LS161
参数 测试条件【1】
最小 最大 最小 最大
单位
IIK=-12mA -1.5
VIK 输入钳位电压 Vcc 最小
IIK=-18mA -1.5
V
54 2.4 2.5
VOH 输出高电平电压
Vcc=最小,VIH=2V,VIL=最大,
IOH=最大 74 2.4 2.7
V
54 0.4 0.4
VOL 输出低电平电压
VCC=最小,VIH=2V,VIL=最大,IOL=最
大 74 0.4 0.5
V
A-D,ENP,CLEAR 1 0.1 II 最大输
入电压时
输入电流 LOAD,CLOCk,ENT
Vcc=最大 VI=5.5V(‘LS161 为 7V)
1 0.2
mA
A-D,ENP,CLEAR 40 20
LOAD 40 40
IIH 输入高
电平电流
CLOCK,ENT
Vcc=最大 VIH=2.4V(‘LS161 为
2.7V)
80 40
μA
A-D,ENP,CLEAR -1.6 -0.4
LOAD -1.6 -0.8
VIL 输 入
低电平电
流 CLOCK,ENT
Vcc=最大 VIL=0.4V
-3.2 -0.8
mA
54 -20 -57 -20 -100
IOS 输出短路电流 Vcc=最大
74 -18 -57 -20 -100
mA
54 85 31
IccH 输出高电平时电源电流
Vcc=最大,LOAD 先接高电平,再接低
电平,其余输入接高电平 74 94 31
mA
54 91 32
IccL 输出低电平时电源电流
Vcc=最大,CLOCK 先接高电平,再接低
电平,其余输入接低电平 74 101 32
mA
【1】:测试条件中的“最大”和“最小”用推荐工作条件中的相应值。
动态特性(TA=25℃)
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‘161 ‘LS161 参数【2】 测试条件 最小 最大 最小 最大 单位
fmax 25 25 MHz
tPLH 35 35
tPHL
CLOCk->RCO
35 35
ns
tPLH 20 24
tPHL
CLOCk->Q
(LOAD=H) 23 27 ns
tPLH 25 24
tPHL
CLOCk->Q
(LOAD=L) 29 27 ns
tPLH 16 14
tPHL CLOCk->RCO 16 14 ns
tPHL CLEAR->Q
Vcc=5V
CL=15pF
RL=400Ω
(‘LS161 为 2KΩ)
38 28 ns
【2】:fmax-最大时钟频率
tPLH-输出由低到高电平传输延迟时间
tPHL-输出由高到低电平传输延迟时间
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