[论文]实验二：用一位全加器设计一个四位的加法器

[论文]实验二：用一位全加器设计一个四位的加法器[论文]实验二：用一位全加器设计一个四位的加法器实验二:用一位全加器设计一个四位的加法器实验二:用一位全加器设计一个四位的加法器 1.实验目的 1.实验目的熟悉软件MAX+plusII掌握EDA实验仪的使用方法熟悉软件掌握EDA实验仪的使用方法 2.实验内容 2.实验内容 a.利用一位全加器设计一个四位的加法器一位全加器设计一个四位的加法器 b.利用MAX+plus?软件，对下图所示的逻辑图进行编译和仿真，并选择器件进行定时分析。 3.实验过程 3.实验过程 a) 建立项目文件夹,取名为s_...

[论文]实验二：用一位全加器设计一个四位的加法器实验二:用一位全加器设计一个四位的加法器实验二:用一位全加器设计一个四位的加法器 1.实验目的 1.实验目的熟悉软件MAX+plusII掌握EDA实验仪的使用方法熟悉软件掌握EDA实验仪的使用方法 2.实验内容 2.实验内容 a.利用一位全加器设计一个四位的加法器一位全加器设计一个四位的加法器 b.利用MAX+plus?软件，对下图所示的逻辑图进行编译和仿真，并选择器件进行定时分析。 3.实验过程 3.实验过程 a) 建立项目文件夹,取名为s_adder a) 建立项目文件夹,取名为s_adder b) 输入设计项目和存盘(附上原理图) b) 输入设计项目和存盘(附上原理图) (1)在原理图编辑窗口中插入4个一位全加器。 (1)在原理图编辑窗口中插入4个一位全加器。 (2)再将它们联接成一个四位的加法器。 (2)再将它们联接成一个四位的加法器。 (3)输入两个4位的二进制数，输出一个4位的和，一位进位。 (3)输入两个4位的二进制数，输出一个4位的和，一位进位。 (4)A3A2A1A0 + B3B2B1B0 = S3S2S1S0 进位 C4 (4)A3A2A1A0 + B3B2B1B0 = S3S2S1S0 进位 C4 (5)为了使输入输出的线减少，可以使用总线加标号的画法。 (5)为了使输入输出的线减少，可以使用总线加标号的画法。 (6)单条线间的联接也可以用标号联接，减少走线的长度，使图面简洁明了。 (6)单条线间的联接也可以用标号联接，减少走线的长度，使图面简洁明了。 c) 将设计项目设置成工程文件 c) 将设计项目设置成工程文件 d) 选择目标器件并编译 d) 选择目标器件并编译首先选择最后实现本项设计的目标器件;其次对工程文件进行编译，综合和首先选择最后实现本项设计的目标器件;其次对工程文件进行编译，综合和适配等操作，最后消去Quartus，完成编译。适配等操作，最后消去Quartus，完成编译。 e) 时序仿真(附波形图) e) 时序仿真(附波形图) 首先建立波形文件，输入信号点，其次设置波形参量，设定访真时间，加上首先建立波形文件，输入信号点，其次设置波形参量，设定访真时间，加上输入信号，文件存盘，运行访真器件，观察分析加法访真波形，打开时序分输入信号，文件存盘，运行访真器件，观察分析加法访真波形，打开时序分析器，精确测量加法器输入和输出波形间的延长量析器，精确测量加法器输入和输出波形间的延长量 f) 引脚锁定 f) 引脚锁定加法器选用结构图 1, 引脚对应情况实验板位置加法器信号通用目标器件引脚名目标器件EP1K30TC144引脚号键4 a0 PIO12 26 键4 a1 PIO13 27 键4 a2 PIO14 28 键4 a3 PIO15 29 键3 b0 PIO8 20 键3 b1 PIO9 21 键3 b2 PIO10 22 键3 b3 PIO11 23 数码管8 s0 PIO28 68 数码管8 s1 PIO29 69 数码管8 s2 PIO30 70 数码管8 s3 PIO31 72 发光二级管D8 c4 PIO39 86 g)编译并编程下载,硬件测试逻辑功能 g)编译并编程下载,硬件测试逻辑功能加法器加法器输入输出键1(a[3..0]) 键2(b[3..0]) c4 S[3..0] 低低低低低高低高高低低高高高高低 4.实验结果 (分析电路功能) 4.实验结果 (分析电路功能) 5.遇到问题及解决方法 5.遇到问题及解决方法 (1)在连接原理图的时候，会遗漏某些字母或是忘记连接某些线，造成实验无法运行。解决方法:我认真的检查核对是否有遗漏的地方，然后及时的改正。 (2)在做加法器s.gdf的仿真波形时，会忘记保存直接运行，导致结果不出来。解决方法:保存s.gdf，然后再运行。连接线时，要谨慎，否则很容易看错，连接错误。【附图】原理图波形图

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