为什么美国依仗“印钞机”玩命印钞票？
数字电子电路期末练习
题
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一． 题A
1、 已有逻辑电路如图1所示，请画出其对应的真值
表
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。
图1 2、 已知四变量函数，试用卡诺图化简，求出最简与-或式。 3、 有一简单时序逻辑电路如图2所示，试写出当C=1和C=0时电路的下一状态方程Qn+1，并说出各自实现的功能。
图2
4、 如图3所示电路的输入信号波形如图4所示。设电路的起始状态为1，试画出相应的Q的输出波形。
图3 Q 图4
5、 若如图5电路的初始状态为QQ=00，当输入序列X=010101101时，输出序列Z是什么？由此可见，电路实现了什么12
功能？
图5
.
1、下图中，对应CP和A的波形，画出输出Q的波形。（设触发器初态为0）
2、在下图中，已知CP 波形，画出对应Q端和端的波形。
.
1、 分析下图，写出F的表达式，并用最少的与非门实现其功能（设输入端的原、反变量均提供），画出逻辑电路图。
2、 下图为由异步清零、同步置数的同步四位二进制加法计数器74161的功能真值表及构成计数器的电路，设初态为QQQ=0000，试画出其状态转换图（QQQQ），说明是几进制计数器。 DCBADCBAQ
输 入 输 出 Cp Cr LD P T A B C D QA QB QC QD × 0 × × × × × × × 0 0 0 0 ? 1 0 × × A B C D A B C D × 1 1 0 × × × × × 保 持 × 1 1 × 0 × × × × 保 持 ? 1 1 1 1 × × × × 计 数
3、 下图为由异步清零、同步置数的同步四位二进制加法计数器74161的功能真值表及构成计数器的电路，设初态为
QQQQ=0000，试画出其状态转换图（QQQQ），说明是几进制计数器。 DCBADCBA
BBB，当其值大于 8421. 或等于5时，输出F=1，反之F=0。输入端只有原变量可用。画出逻辑电路图。 2. 用与非门
设计
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一个组合电路，用来检测并行输入的四位二进制数B3、用JK触发器和必要的逻辑门，设计一个同步五进制加法计数器。 4、用JK触发器和必要的逻辑门，设计一个同步四进制加计数器。 5、设计一个4输入的检测电路，输入信号A，B，C，D为8421BCD码，当输入的BCD数可以被2和3整除时，输出为
1。请：
? 列出电路的真值表。? 化简真值表。
? 用与非门实现此电路，输入信号可以有反变量。
? 用四选一数据选择器及少量逻辑门实现此电路。
6、试用ROM来完成一个逻辑电路，
要求
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能对两个一位二进制数全减计算。 7、用中规模计数器芯片可以灵活地实现各种计数器：
? 用74LS192实现8421码十进制计数器，即计数状态应从0000到1001循环，画出逻辑图。 ? 用两个这样的十进制计数器构成一个十进制模100计数器，画出连接图。? 用两个这样的十进计数器和少量逻辑
门，构成一个十进制模80计数器，画出连接图。(注：此问，也可不用逻辑门。) 注：74LS192功能表见表1。
表1 74LS192功能表
CP CP CR DCBA QQQQ ADDCBA
Ф Ф Ф 1 ФФФФ 0 0 0 0
Ф Ф 0 0 d c b a d c b a
1 1 0 ФФФФ 加计数
1 1 0 ФФФФ 减计数
1 1 1 0 ФФФФ 保持原状态 端子说明：
CP：加计数时钟输入 CP：减计数时钟输入 AD
：预置控制输入 CR：复位输入
D.C.B.A：预置输入 C0：进位输出，加计数到1001后，输出脉冲。 B0：借位输出，减计数到0000后，输出脉冲。
QD QC QB QA CPA CO CPD 74ls192 CR B0 D C B A
8、设计一个可变进制的同步计数器。它有一个控制端M:当M=0时，实现六进制计数器；M＝1时，实现四进制计数器。请用D触发器和门电路实现，画出驱动方程、状态方程、输出方程、状态转换图、
最简逻辑图。
1．图（1）所示卡诺图的逻辑关系式为Y=（ ）。
2．逻辑函数的最简与或式是（ ）；由该逻辑函数组成的电路是否存在着竞Z,(AB，AB，AB)(AC，BC，AB)
争冒险的现象（ ）。
3．写出图（2）所示电路输出与
输入关系的逻辑表达式Y=
（ ）。
4．图（3）所示电路为用555定
时器组成的多谐振荡器，要降低该电
路的振荡频率，电位器VR必须向（上
/ 下）调，VR变化时，输出信号的占
空比δ是变（大 / 小）了。
5．图（4）电路中的74160为同
步十进制计数器，该器件的端口为LD
置数端，ET和EP接高电平“1”时74160处在计数的状态，74160和数据选择器74LS152组成序列信号发生器，该电路可输出的序列信号是（ ）。
6．五位D/A转换器的参考电压U为8V，输入的数据D=10110，该器件的输出电压U= （ ）V REFnO
7．某一模拟信号中含有最高频率为5kHz的信号，要将该信号转换成数字信号，采样信号频率的最小值为
（ ）。
8．将每一片存储容量为8×4的ROM扩展成存储容量为64×4ROM阵列，扩展后的地址码是（ ）位的二进制数
9．图（5）所示电路为由两个三态门组成的总线结构，能正确描述该电路输出和输入关系的波形是图（5）所示的（ ）。
10．写出将D触发器转换成JK触发器的方程（ ）并利用图（6）给出的芯片引脚排列图，利用74LS00与非门将D触发器7474改接成JK触发器。
11、四位全加器T1283和移位寄存器74194接成并行输入加法器，已知加法器输入的数据为D，74194的工作状态表
3D
2
及输入的波形图如图（7）所示，则加法器输出数据的表达式Y= （ ）。
（A）、6D （B）、 （C）、 （D）、3D
3D
4
12．请利用图（8）的四位全加器，将输入的余3码变换成BCD码输出，已知BCD码（B3B2B1B0）和余3码（Y3Y2Y1Y0）
的关系为Y3Y2Y1Y0 = B3B2B1B0 + 0011。
13．图（9）的74161为十六进制的计数器，功能脚的接法与74160的功能脚接法相同，请说明图（9）所示的电路是（ ）的计数器，若CP输入信号的频率为74kHz，输出端Y输出信号的频率为（ ）。
14．将图（10）所示的电路连接成能产生5个顺序低电平脉冲信号输出的电路。图（10）中的74138是3到8线译码器。
15．写出图（11）所示电路输出Y的
标准
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与或式Y
和最简与或式Y。图中的集成电路为412
选1数据选择器。
Y=（ ） 1
Y=（ ） 2
二．计算题
16．图（12）所示的电路为用ROM构成的逻辑函数与或阵列图，请用PLD器件实现它。
17、请用多片（74LS00）四2输入与非门设计一个三输入信号的表决器（表决器的逻辑功能是少数服从多数）。74LS00的引脚功能如图（13）所示。
QQ = 010，画出电路的32118．如图（14）所示电路中的触发器为TTL器件，写出电路的状态方程，设电路的初
状态转换图和时序图，并说明该态为Q
电路的逻辑功能，画出用PLD器
件实现该电路的电路图。
浙公网安备 33021202002483