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cadence教程cadence1在PC机上运行cadence需要先运行命令:source filename,此处filename指.cshrc,或其他具有该文件内容但名字不同的文件,该文件必须有set DISPLAY 本机IP:0.0;语句,同时应将其他雷同设置封住.可以先从工作站上下载.cshrc文件,然后用notepad修改显示设置相,不可用其他编辑器,否则文本文件格式会不一样.记住,必须将显示器设置为256色. 版图设置: ..../Editing Technology Data for layers->Editing layer disp...

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在PC机上运行cadence需要先运行命令:source filename,此处filename指.cshrc,或其他具有该文件内容但名字不同的文件,该文件必须有set DISPLAY 本机IP:0.0;语句,同时应将其他雷同设置封住.可以先从工作站上下载.cshrc文件,然后用notepad修改显示设置相,不可用其他编辑器,否则文本文件格式会不一样.记住,必须将显示器设置为256色. 版图设置: ..../Editing Technology Data for layers->Editing layer displayer P8 把display.drf (定义layers在screen 中怎样显示的文件,如颜色,线型等)文件copy到账号目录下,在lsw窗口下edit 菜单下load display.drf,然后 set valid layers .....,在谈出窗口选 all valid ....,层次名字在ciw窗口内technology file 菜单下edit layer 中改.同时,在自己的主目录下应该有一些cadence 的配置文件(在目录cadencex中) which layoutPlus& 命令可以指出版图软件的安装目录 CIW->options->user references 对应 .cdsinit startup file instdir命令指出cadence 的安装目录, cd cadence安装目录/samples/tutorials/le下的cell_design拷贝到自己的主目录,即可使用tutorials的帮助例子.cd ~/cell_design , playoutPlus& basic库 : ground , power, input &output pins等basic symbols cdsDefTechlib库 : contains the default technology files samples库: a collection of gates and cells 在 create new cellview 对话框中,viewname 定义为layout 后,系统会自动选取对应的工具 Virtuso Editing Technology Data for layers -> Editing layer displayer P8 layout 中的一些快捷键 cds.log文件纪录CIW中出现的命令行 工艺库是通过对弈有的ASCII文件(techfile.cds)编译后产生二进制文件(文件名不可改),也可从已有的工艺库中载入 CIW:technology file->new 将工艺库与design或cell,view相连(有一项techlibname属性) CIW:TECHNOLOGY FILE->ATTACH TO (attach to desing library ,cell,view) CdslibEditor 可以察看cds.lib(对应一个design)中有关库文件的分布,命令行 CdsLibEditor&. 用UNIX text editor创建cds.lib:1.打开一个文件叫cds.lib 2. 加入DEFINE basic(库名) $目录名 3. save hierEditor& 用来察看design 的各模块层次关系(pcb,sch....) expand.cfg LSE:verilog language sensitive Editor 用来进行edit及语法查错的工具(verilog XL的工具之一,SimVision是verilog-XL的图形界面) HDLTOOLS->schmetic entry->acess datapath library datablook 罗列了一堆标准器件的功能(有verilog 描述0.5u 3层布线.与工艺无关的叫datapath,datapath有自己的schmetic 和symbol,在schmetic设计中add instance 即可用datapath) HDLTOOLS->schmetic entry->checkplus for composer user guide 关于利用checkplus和maker(标志错误)来检查schmetic 的(IC, FPGA, ASIC)设计规则无效星.checkplus集成在composer中,可以自己定义规则集(用RULE LANGUAE) CIW:TOOLS->CHECKPLUS(interactive mode), a sample to test rules:..... HDLTOOLS->schmetic entry->composer:design entry help (详细介绍),启动composer: icde&:including schmetic editor,symbol editor, plotting icds&:plus checkplus, simulation, sythesis icms&:plus mixed signal functionality including analog artist library 定义:both a logical collection of cells, views, and technology information and a physical collection of files and directoris that can reside anything in the file/system 启动 librarymanager : libManager&
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分类:互联网
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